2.4G输出小数分数锁相环，频率综合器，锁相环进阶项目，Cadence家的，有完整的设计仿真报告ppt等文档?配套视频讲解?完整的版图

工艺是gpdk45nm，输入参考频率20MHz，电荷泵电流50.2uA，VCO输出4.8GHz，Kvco＝90MHz/V，锁相环输出2.4GHz，分频比240，换路带宽133K，相位裕度62°。

适合新手，或者想要深入学习锁相环的同学，一共有七八十个仿真sim testbench，都有配套的说明仿真文档介绍，可以直接仿真查看效果

里面很多模块都是非常经典的，有bg，LDO，宽范围的LC VCO（32个band），IQ分频，SDM小数调制，有源滤波器，Verilog-A相位噪声建模，VCO校准，环路滤波器校准，温度计数码开关，AMS数模混合仿真等等

有完整的版图，top，cell的都有。

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