基于FPGA的4路视频拼接（verilog）

功能：将HDMI（1920×1080@60）、摄像头（960×540@30）、以太网（960×540）做4路视频拼接（其中HDMI复用1次）。

可以通过修改模块输入实现任意4路输入视频源拼接

硬件平台：紫光同创 盘古-50k

软件编写烧录平台：PDS 2022.1

如需修改功能请自行实现哦

已获FPGA竞赛国二

ID:1466

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